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고속 DRAM를 위한 클락 그리고 데이터 복구 회로
대한전자공학회 학술대회
2007 .07
A 5-Gb/s 11.4㎽ Half-Rate CDR in 0.18㎛ CMOS
대한전자공학회 ISOCC
2013 .11
5.4Gbps/3.24Gbps Dual-rate CDR with Quarter-rate Linear Phase Detector
ITC-CSCC :International Technical Conference on Circuits Systems, Computers and Communications
2009 .07
다중속도의 광신호 추출 및 클락-데이터 복원회로 설계
센서학회지
2003 .01
광대역 전디지털 클록 데이터 복원회로 설계
전기학회논문지
2012 .11
이중 보간 방식을 이용한 CMOS 클록 데이터 복원회로
대한전자공학회 학술대회
2009 .07
A CMOS 5.4/3.24-Gbps Dual-Rate CDR with Enhanced Quarter-Rate Linear Phase Detector
[ETRI] ETRI Journal
2011 .10
1/8-Rate Phase Detector를 이용한 클록-데이터 복원회로
전자공학회논문지
2014 .01
A 2.7Gbps & 1.62Gbps Dual-Mode Clock and Data Recovery for DisplayPort
대한전자공학회 ISOCC
2008 .11
기준 클럭이 없는 300Mbps ~ 4.0Gbps 클럭 데이터 복원 회로
대한전자공학회 학술대회
2008 .05
Design and analysis of phase detector as mixers for 10Gb/s Clock signal
한국통신학회 학술대회논문집
2003 .11
고속 직렬 디스플레이 인터페이스를 위한 1/4-rate 클록 데이터 복원회로 설계
전기학회논문지
2011 .02
A 5.4Gbps/3.24Gbps Dual-rate CDR with Strengthened Up/Down Pulse Ratio
대한전자공학회 ISOCC
2009 .11
클락-데이터 복원회로를 포한한 5.8-Gb/s 수신단 설계
대한전자공학회 학술대회
2012 .06
1 Gb/s gated-oscillator burst mode CDR with half-rate clock recovery
대한전자공학회 ISOCC
2004 .10
622Mbps급 광 통신망용 버스트모드 클럭/데이터 복원회로 설계
전자공학회논문지-SD
2009 .02
Wide-Tracking Range Clock and Data Recovery Circuit의 CPPSIM 모델링
대한전자공학회 학술대회
2009 .11
Well-trimmed 위상검출기를 이용한 클럭 및 데이터 복구회로 설계
대한전자공학회 학술대회
2007 .07
1Gb/s gated-oscillator burst mode CDR for half-rate clock recovery
JOURNAL OF SEMICONDUCTOR TECHNOLOGY AND SCIENCE
2004 .12
1/4-rate 클록을 이용한 이중 보간 방식 기반의 CDR
전자공학회논문지-SC
2009 .01
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