오차범위 분석을 통한 고정길이 modified Booth 곱셈기의 최대오차 감소

조경주; 정진균

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자료유형: 학술저널

저자정보: 조경주 정진균

저널정보: 대한전자공학회 전자공학회논문지-SD 전자공학회논문지 SD편 제42권 제10호

발행연도: 2005.10

수록면: 29 - 34 (6page)

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최대 양자화 오차는 W 비트 입력으로부터 W 비트의 곱을 출력하는 고정길이 곱셈기의 성능에 많은 영향을 준다. 본 논문에서는 고정길이 modified Booth 곱셈기의 오차범위를 분석한 후 최대오차를 줄이기 위해 추가해야 하는 칼럼 수를 결정하는 방법을 제안한다. 또한, 오차범위 분석방법이 reduced-width 곱셈기 디자인 시에도 적용할 수 있음을 보인다. 시뮬레이션을 통해 제안한 오차분석 방법이 고정길이 modified Booth 곱셈기의 실제 디자인에 유용하게 사용될 수 있음을 보인다.

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[학술지(정기간행물)] - J. M. Jou / Jun.1999. / Design of a low-error fixed-width multiplier for DSP applications 46 : 836 ~ 842

[학술지(정기간행물)] - S. M. Kim / Dec.2003. / Low error fixed-width CSD multiplier with efficient sign extension 50 : 984 ~ 993

[학술지(정기간행물)] - M. A. Song / jul.2004. / A generalized methodology for low-error and area-time efficient fixed-width Booth multipliers : 9 ~ 12

[학술지(정기간행물)] - K. J. Cho / May2004. / Design of low error fixed-width modified Booth multiplier 12 : 522 ~ 531

[학술지(정기간행물)] - K. J. Cho / nov.2004. / Error bound reduction for fixed-width modified Booth multipier

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