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저자정보
김용은 (전북대학교) 이주영 (전북대학교) 양상훈 (전북대학교) 정진균 (전북대학교)
저널정보
대한전자공학회 대한전자공학회 학술대회 대한전자공학회 2006년도 추계학술대회 논문집Ⅱ
발행연도
2006.11
수록면
1,165 - 1,168 (4page)

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Carry-increment adders are commonly used due to its small size and fast speed. However, if the number of input bits is large, the speed would be much slow and the power consumption would increase because of its large fan-outs. This paper proposes the way to keep the number of fan-outs three regardless of the number of input bits. The 36 bit adder simulation result shows that the speed can increase up to 24% compared with the conventional design.

목차

Abstract
Ⅰ. 서론
Ⅱ. 본론
Ⅲ. 시뮬레이션
Ⅳ. 결론
참고문헌

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