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A Design of High Speed Adder Circuit Using Redundant Binary Code
ICVC : International Conference on VLSI and CAD
1997 .01
혼합 가산기를 위한 부가산기의 순서와 비트 할당 연구
대한전자공학회 학술대회
2006 .11
고성능 가산기의 최적화 연구
한국통신학회논문지
2004 .05
Analysis on Full Adder with Restoring Function in Nominal and Low Supply Voltage
대한전자공학회 학술대회
2017 .01
새로운 구조의 고속 1비트 전가산기 회로설계
대한전자공학회 학술대회
2009 .07
고속동작 가능한 새로운 1-비트 전가산기 설계
대한전자공학회 학술대회
2007 .11
An Input Pattern Based Area Reduction Technique for Adder Structures in Low Power Applications
대한전자공학회 ISOCC
2006 .10
An Accuracy Enhanced Error Tolerant Adder with Carry Prediction for Approximate Computing
IEIE Transactions on Smart Processing & Computing
2019 .08
Enhanced Low-Power High-Speed Adder For Error-Tolerant Application
대한전자공학회 ISOCC
2010 .11
Modified Carry-Increment Adder Design
대한전자공학회 학술대회
2006 .11
저전력 Approximate Floating Point Adder 설계
대한전자공학회 학술대회
2020 .08
캐스캐이드 ADDER 회로 설계 및 시뮬레이션에 관한 연구
한국통신학회 학술대회논문집
2018 .01
정확도를 높인 Approximate Adder 설계
대한전자공학회 학술대회
2020 .08
Ultra Low-Power High-Speed Flexible Probabilistic Adder for Error-Tolerant Applications
대한전자공학회 ISOCC
2011 .11
A Design of High-Speed 1-Bit Full Adder Cell using 0.18 ㎛ CMOS Process
ITC-CSCC :International Technical Conference on Circuits Systems, Computers and Communications
2008 .07
Low-Power Multimedia DSP Systems
ICVC : International Conference on VLSI and CAD
1997 .01
High-Level Synthesis using Carry-Save-Adders
대한전자공학회 ISOCC
2004 .10
Low Power Latch-adder Based Multiplier Design
JOURNAL OF SEMICONDUCTOR TECHNOLOGY AND SCIENCE
2017 .12
DSP를 위한 새로운 저전력 상위 레벨 합성
대한전자공학회 학술대회
2002 .06
Memristor Based Full Adder Circuit for Better Performance
Transactions on Electrical and Electronic Materials
2019 .01
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