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대한전자공학회 전자공학회논문지-SD 電子工學會論文誌 SD編 第46卷 第9號
발행연도
2009.9
수록면
74 - 80 (7page)

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본 논문은 싱글의 LC-탱크 전압제어발진기(VCO)를 사용한 2∼6㎓의 CMOS 주파수 합성기에 관하여 기술하였다. 광대역에서 동작하는 주파수 합성기 설계를 위해 최적화된 로컬발진기(LO) 신호 발생기를 사용하였다. LO 신호 발생기는 LC-탱크 VCO와 이 신호를 분주하고 혼합하는 방법으로 광대역의 주파수에서 동작하도록 구현하였다. 주파수 합성기는 3차 1-1-1 MASH 타입의 시그마-델타 모듈레이터(SDM)를 사용한 소수 분주 위상잠금루프(PLL)에 기초로 설계되었다. 제안한 주파수 합성기는 0.18㎛ CMOS 공정기술을 사용하여 설계하였고, off-chip 루프 필터를 가지고 0.92㎟의 칩 면적을 차지하며, 1.8V 전원에서 36㎽ 이하의 전력을 소모한다. PLL은 8㎲보다 적은 시간에서 록킹을 완료한다. 위상 잡음은 중심 주파수 신호로부터 1㎒ 오프셋에서 -110㏈c/㎐보다 작다.
#전압제어발진기(VCO) #주파수 합성기 #위상잡음 #자동주파수조절(AFC)

목차

요약
Abstract
Ⅰ. 서론
Ⅱ. 주파수 합성기의 구조 및 주파수 계획
Ⅲ. 각 블록 회로의 설계
Ⅳ. 실험 결과
Ⅳ. 결론
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