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논문 기본 정보

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학술저널
저자정보
조형준 (성균관대학교) Chenglin Cui (성균관대학교) 김성규 김병성 (성균관대학교)
저널정보
한국전자파학회 한국전자파학회논문지 韓國電磁波學會論文誌 第24卷 第10號
발행연도
2013.10
수록면
971 - 978 (8page)

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본 논문에서는 65 nm RF CMOS 공정을 이용하여 26 ㎓ 위상 고정 루프(PLL)를 설계하고, 주파수 3체배기(tripler)를 이용하여 W 밴드 주파수 합성기를 설계하였다. 26 ㎓ VCO는 22.8~26.8 ㎓, 3체배기의 출력은 74~75.6 ㎓의 주파수 조정 범위를 갖는다. 제작한 주파수 합성기는 총 75.6 ㎽의 전력을 소모하며, 3체배기의 최종 출력은 1 ㎒ 오프셋에서 ?75 ㏈c/㎐, 10 ㎒z 오프셋에서 ?101 ㏈c/㎐z의 위상 잡음 특성을 갖는다.

목차

요약
Abstract
Ⅰ. 서론
Ⅱ. 본론
Ⅲ. 결론
References

참고문헌 (9)

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