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대한전자공학회 전자공학회논문지-SD 電子工學會論文誌 SD編 第46卷 第7號
발행연도
2009.7
수록면
61 - 67 (7page)

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본 논문에서는 0.25-㎛ 디지털 CMOS공정으로 제작된 UHF대역 RFID를 위한 무선통신용 쿼드러처(Quadrature) 출력이 가능한 Integer-N방식의 PLL 주파수 합성기를 설계 및 제작하여 측정하였다. Integer-N 방식의 주파수 합성기의 주요 블록인쿼드러처 전압제어 발진기(Voltage Controeld Oscillator, VCO)와 위상 주파수 검출기(Phase Frequency Detector, PFD), 차지펌프(Charge Pump, CP)를 설계하고 제작하였다. 전압제어발진기는 우수한 위상노이즈 특성과 저전력 특성을 얻기 위해 LC공진기를 사용하였으며 전압제어 가변 캐패시터는 P-channel MOSFET의 소스와 드레인 다이오드를 이용하여 설계되었으며 쿼드러처 출력을 위해 두 개의 전압제어발진기를 서로 90도 위상차를 가지도록 설계하였다. 주파수 분주기는 프리스케일러(Pre-scaler)와 아날로그 디바이스사의 칩 ADF4111을 사용하였으며 루프 필터는 3차 RC필터로 설계하여 측정하였다. 측정결과 주파수 합성기의 RF 출력 전력은 50옴 부하에서 -13㏈m이고, 위상 잡음은 100㎑ offset 주파수에서 -91.33㏈c/㎐ 이었으며, 동작 주파수영역은 최소 930㎒에서 최대 970㎒이고 고착시간은 약 600㎲이다.
#PLL #VCO #Integer-N #Phase noise #Frequency synthesise

목차

요약
Abstract
Ⅰ. 서론
Ⅱ. Integer-N PLL 주파수 합성기
Ⅲ. 실험 및 측정 결과
Ⅳ. 결론
참고문헌
저자소개

참고문헌 (10)

참고문헌 신청
1. [학술지(정기간행물)] - 표철식 / 2004 / UHF RFID / TTA Journal (94) : 123 ~ dbpia 2. [단행본] - William F.Egan / 1999 / Frequency Synthesis by Phase Lock / Wiley Inter-science google schola 3. [보고서] - Curtis Barrett / 1999 / Fractional/Integer-N PLL Basics : 39 ~ 40 google schola 4. [단행본] - Keliu Shu / 2005 / CMOS PLL SYNTHESIZERS Analysis and Design / Springer : 33 ~ google schola 5. [기타자료] - Saurabh Sinha / 2002 / Design of an integrated CMOS PLL frequency synthesizer / IEEE MELECON 2002 : 222 ~ google schola

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