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논문 기본 정보
- 자료유형
- 학술저널
- 저자정보
- 발행연도
- 2004.10
- 수록면
- 69 - 75 (7page)
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본 논문에서는 온도 및 전원전압에 덜 민감한 기준전압을 위해 온-칩 필터를 사용하는 8b 220 MS/s 230 mW 3단 파이프라인 CMOS A/D 변환기 (ADC) 회로를 제안한다. 제안하는 RC 저대역 필터는 기존의 큰 값을 가진 칩 외부의 바이패스 캐패시터를 사용하지 않고도 고속 동작 시 발생하는 여러 가지 잡음을 효과적으로 감쇄시키고 큰 R, C 부하에서도 기준전압의정착시간을 줄인다. 시제품 ADC는 0.25 um CMOS 공정을 이용하여 설계 및 제작되었고, 입/출력단의 패드를 제외한 코어면적은 2.25 mm2 이며 측정된 DNL 및 INL은 각각 -0.3S~+0.43 LSB, -0.82~+0.71 LSB 수준을 보여준다. 또한, SNDR은 200 MS/s, 220 MS/s 샘플링 주파수에서 입력 주파수가 수 MHz에서 110 MHz까지 증가할 때 각각 43 dB 및 41 dB로 유지되었고, 입력주파수가 500 MHz 까지 증가할 때는 입력주파수가 110 MHz의 경우에 비해 3 dB 정도만 감소되었다.
목차
요약
Abstract
Ⅰ. 서론
Ⅱ. 제안하는 ADC의 전체 구조
Ⅲ. 제안하는 회로 설계 기법
Ⅳ. 시제품 ADC 성능 측정
Ⅴ. 결론
참고문헌
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[학술지(정기간행물)] - Y. T. Wang / mar.2000. / An 8-bit 150 -MHz CMOS A/D Converter 35 : 308 ~ 317
[학술지(정기간행물)] - G. Feygin / May2001 / A 165 MS/s 8-bit CMOS A/D converter with background offset cancellation : 153 ~ 156
[학술지(정기간행물)] - S. S. Kim / May2001 / An 8-bit 200 MSPS CMOS A/D converter for analog inter -face module of TFT-LCD driver 1 : 528 ~ 531
[학술지(정기간행물)] - J. Vandenbussche / May2002 / A 8-bit 200 MS/s Interpolating/Averaging CMOS A/D Converter : 445 ~ 448
[학술지(정기간행물)] - K.Oulton / Feb.2002 / A 4GSample/s 8b ADC in 0.35 um CMOS : 126 ~ 127
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