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논문 기본 정보
- 자료유형
- 학술저널
- 저자정보
- 발행연도
- 2011.1
- 수록면
- 14 - 21 (8page)
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본 논문에서는 LTE-Advanced, software defined radio(SRD)등 4G 이동통신 핵심기술에 응용 가능한 10b 500MS/s 0.13㎛ CMOS A/D 변환기(ADC)를 제안한다. 제안하는 ADC는 저전력 특성을 만족하기 위해 특별한 보정기법을 포함하지 않는 단일 채널 형태로 설계되었으며, 500MS/s의 고속 변환속도를 만족하기 위해 폴딩 신호처리 기법을 사용하였다. 또한 하위 7b ADC의 높은 folding rate(FR)을 극복하기 위해 cascaded 형태의 폴딩-인터폴레이팅 기법을 적용하였으며, 폴딩 버스에서 발생하는 기생 커패시턴스에 의한 주파수 제한 및 전압이득 감소를 최소화하기 위해 folded cascode 출력단을 갖는 폴딩 증폭기를 설계하였다. 제안하는 ADC는 0.13㎛ 1P6M CMOS 공정으로 설계되었으며 유효면적은 1.5㎟이다. 시제품 ADC의 INL, DNL은 10b 해상도에서 각각 2.95LSB, 1.24LSB 수준으로 측정되었으며, 입력주파수 9.27MHz, 500MHz의 변환속도에서 SNDR은 54.8dB, SFDR은 63.4dBc의 특성을 보인다. 1.2V(1.5V)의 전원전압에서 주변회로를 포함한 전체 ADC의 전력소모는 150mW(300μW/MS/s)이다.
목차
요약
Abstract
Ⅰ. 서론
Ⅱ. 본론
Ⅲ. 실험결과
Ⅳ. 결론
참고문헌
저자소개
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1. [학술지(정기간행물)] - Simon M. Louwsma / 2008 / A 1.35GS/s, 10b, 175mW Time-Interleaved AD Converter in 0.13μ m CMOS / IEEE J. Solid-State Circuits 43 (4) : 778 ~ 786
2. [학술지(정기간행물)] - Sandeep K. Gupta / 2006 / A 1-GS/s 11-bit ADC with 55-dB SNDR, 250-mW Power Realized by a High Bandwidth Scalable Time-Interleaved Architecture / IEEE J. Solid-State Circuits 41 (12) : 2650 ~ 2657
3. [학술지(정기간행물)] - Robert C. Taft / 2004 / A 1.8-V 1.6-GSample/s 8-b Self-Calibrating folding ADC With 7.26 ENOB at Nyquist Frequency / IEEE J. Solid-State Circuits 39 (12) : 2107 ~ 2115
4. [학술대회논문] - Ivan Bogue / 2007 / A 57dB SFDR Digitally Calibrated 500MS/s folding ADC in 0.18μm digital CMOS / Proc. IEEE CICC : 337 ~ 340
5. [학술지(정기간행물)] - 정승휘 / 2006 / 1.8V 8-bit 500MSPS Cascaded-Folding Cascaded-Interpolation CMOS A/D 변환기의 설계 / 전자공학회논문지 - SD 43 (5) : 1 ~ 10
2. [학술지(정기간행물)] - Sandeep K. Gupta / 2006 / A 1-GS/s 11-bit ADC with 55-dB SNDR, 250-mW Power Realized by a High Bandwidth Scalable Time-Interleaved Architecture / IEEE J. Solid-State Circuits 41 (12) : 2650 ~ 2657
3. [학술지(정기간행물)] - Robert C. Taft / 2004 / A 1.8-V 1.6-GSample/s 8-b Self-Calibrating folding ADC With 7.26 ENOB at Nyquist Frequency / IEEE J. Solid-State Circuits 39 (12) : 2107 ~ 2115
4. [학술대회논문] - Ivan Bogue / 2007 / A 57dB SFDR Digitally Calibrated 500MS/s folding ADC in 0.18μm digital CMOS / Proc. IEEE CICC : 337 ~ 340
5. [학술지(정기간행물)] - 정승휘 / 2006 / 1.8V 8-bit 500MSPS Cascaded-Folding Cascaded-Interpolation CMOS A/D 변환기의 설계 / 전자공학회논문지 - SD 43 (5) : 1 ~ 10
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