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논문 기본 정보
- 자료유형
- 학술저널
- 저자정보
- 발행연도
- 2015.4
- 수록면
- 107 - 115 (9page)
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본 논문에서는 Power IC용 저면적 32비트 differential paired eFuse OTP 메모리를 설계하였다. OTP 메모리 셀 어레이에서 행의 개수가 열의 개수보다 더 작은 경우 eFuse 링크의 프로그램 전류를 공급하는 SL (Source Line) 구동 라인을 열 방향으로 라우팅하는 대신 행 방향으로 라우팅하므로 레이아웃 면적을 많이 차지하는 SL 구동회로의 수를 줄이는 differential paired eFuse 셀 어레이 방식과 코어 회로를 제안하였다. 그리고 blowing되지 않은 eFuse 링크가 EM (Electro-Migration) 현상에 의해 blowing되는 불량을 해결하기 위해 RWL (Read Word-Line) 구동 회로와 BL (Bit-Line) 풀-업 부하회로에 V2V ()의 regulation된 전압을 사용하였다. 설계된 32비트 eFuse OTP 메모리의 레이아웃 면적은 으로 기존의 셀 어레이 라우팅을 이용한 IP 크기인 보다 20.7% 더 작은 것을 확인하였다.
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참고문헌 (9)
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1. [학술지(정기간행물)] - 정우영 / 2014 / PMIC용 넓은 동작전압 영역을 갖는 eFuse OTP 설계 / 한국정보통신학회논문지 18 (1) : 115 ~ 122
2. [학술대회논문] - J. Safran / 2007 / A compact eFuse programmable array memory for SOI CMOS / Symposium on VLSI Circuits Digest of Technical Papers : 72 ~ 73
3. [학술대회논문] - N. Robson / 2007 / Electrically programmable fuse (eFuse):From memory redundancy to autonomic chip / Proceedings of Custom Integrated Circuits Conference : 799 ~ 804
4. [학술지(정기간행물)] - J. H. Jang / 2012 / Design of an 8-bit differential paired eFuse OTP memory IP reducing sensing resistance / J. Cent. South Univ 19 (1) : 168 ~ 173
5. [학술지(정기간행물)] - 학문초 / 2014 / Line Scan Sensor용 저면적 eFuse OTP 설계 / 한국정보통신학회논문지 18 (8) : 1914 ~ 1924
2. [학술대회논문] - J. Safran / 2007 / A compact eFuse programmable array memory for SOI CMOS / Symposium on VLSI Circuits Digest of Technical Papers : 72 ~ 73
3. [학술대회논문] - N. Robson / 2007 / Electrically programmable fuse (eFuse):From memory redundancy to autonomic chip / Proceedings of Custom Integrated Circuits Conference : 799 ~ 804
4. [학술지(정기간행물)] - J. H. Jang / 2012 / Design of an 8-bit differential paired eFuse OTP memory IP reducing sensing resistance / J. Cent. South Univ 19 (1) : 168 ~ 173
5. [학술지(정기간행물)] - 학문초 / 2014 / Line Scan Sensor용 저면적 eFuse OTP 설계 / 한국정보통신학회논문지 18 (8) : 1914 ~ 1924
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