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연산시간/회로면적 설계 공간 탐색을 통한 혼합가산기 기반 디지털 회로 설계
한국통신학회논문지
2009 .10
정수 선형 프로그래밍을 이용한 혼합 가산기 구조의 최적 설계
정보과학회논문지 : 시스템 및 이론
2007 .08
신경 회로망을 이용한 32-bit 부동 소수점 방식 가산기 설계
한국통신학회 학술대회논문집
1989 .11
신경 회로망을 이용한 부동 소수점 방식 가산기 설계 ( VLSI implementation of Flouting Point Adder with Neural Network )
대한전자공학회 학술대회
1989 .07
결합 공간 부호화 방법을 이용한 두 단계 변형부호화자리수 가산기 구현
전자공학회논문지-SD
2001 .11
고성능 가산기의 최적화 연구
한국통신학회논문지
2004 .05
광병렬 가산기의 구성을 위한 알고리즘 제안 및 광학적인 구현 ( Algorithm Proposal and Implementation for Optical Parallel Adder )
대한전자공학회 학술대회
1992 .01
신경회로망 특집을 내면서
전기의세계
1989 .02
T-gate를 이용한 GF(2²)상의 가산기 및 승산기 설계
전기전자학회논문지
2003 .07
고속 검사합 모듈의 가산기 구조에 대한 성능 평가의 비교 연구 ( A comparative study on the performance evaluation of adder architecture in high speed checksum module )
대한전자공학회 학술대회
1998 .01
기호치환을 이용한 1-비트 광 가산기 구현 ( Implementation of Optical 1-bit Adder using Symbolic Substitution )
대한전자공학회 학술대회
1993 .01
광병렬 가산기의 구성을 위한 알고리듬 제안 및 광학적인 구현 ( A Proposed Algorithm and its Optical Implementation for Optical Parallel Adder )
전자공학회논문지-B
1992 .12
혼합 가산기를 위한 부가산기의 순서와 비트 할당 연구
대한전자공학회 학술대회
2006 .11
실시간 편광부호화에 의한 광병렬 가산기 구현 ( Implementation of Optical Parallel Adder using Polarization Coding )
한국통신학회논문지
1992 .12
1 - 비트 기호치환 가산기의 광학적인 구현 ( Optical Implementation for 1 - bit Symbolic Substitution Adder )
전자공학회논문지-A
1994 .08
보수 이론을 이용한 32비트 파이프라인 캐리 선택 가산기
전자공학회논문지-SD
2002 .09
다중 시스템의 복수 데이터 취득을 위한 직렬통신
대한전기학회 학술대회 논문집
2002 .07
일반화된 에지값 다치결정도의 구성과 다치전가산기 설계에 관한 연구 ( A Study on the Construction of the Generalized Edge Multiple-Valued Decision Diagram and the Multiple-Valued Full Adder )
대한전자공학회 학술대회
1997 .11
일반화된 에지값 다치결정도의 구성과 다치전가산기 설계에 관한 연구
대한전자공학회 학술대회
1997 .11
완전동형암호로 암호화된 데이터에 적합한 산술 가산기의 구현 및 성능향상에 관한 연구
정보보호학회논문지
2017 .06
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