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Design of an Adder and Multiplier on GF(p) Using T-gate
ITC-CSCC :International Technical Conference on Circuits Systems, Computers and Communications
2003 .07
Implementation of CMOS Ternary Adder and Multiplier Using T-gate
INTERNATIONAL CONFERENCE ON FUTURE INFORMATION & COMMUNICATION ENGINEERING
2010 .06
고성능 가산기의 최적화 연구
한국통신학회논문지
2004 .05
T-Gate에 의한 전류모드 CMOS 3치 가산기 및 승산기의 구현
한국정보기술학회논문지
2012 .03
개선된 조건 합 가산기를 이용한 54x54-bit 곱셈기의 설계 ( Design of a 54x54-bit Multiplier Based on a Improved Conditional Sum Adder )
전자공학회논문지-SD
2000 .01
연산시간/회로면적 설계 공간 탐색을 통한 혼합가산기 기반 디지털 회로 설계
한국통신학회논문지
2009 .10
Low Power Latch-adder Based Multiplier Design
JOURNAL OF SEMICONDUCTOR TECHNOLOGY AND SCIENCE
2017 .12
Implementation of Enzyme-Based Half-Adder with Complete Functionality
한국생물공학회 학술대회
2019 .04
GF ( 3m ) 상의 승산기 구성 이론 ( A Construction Theory of Multiplier on GF ( 3m ) )
대한전자공학회 학술대회
1988 .11
혼합 가산기를 위한 부가산기의 순서와 비트 할당 연구
대한전자공학회 학술대회
2006 .11
GF ( 2 ) 상의 승산기 구성에 관한 연구 ( A Study on the Multiplier for Finite Field GF ( 2 ) )
대한전자공학회 학술대회
1987 .07
전류모드 CMOS를 사용한 병렬 3치 승산기 설계
전자공학회논문지-SC
2002 .03
전류모드 CMOS에 의한 3치 가산기 및 승산기의 구현
한국정보통신학회논문지
2009 .09
GF ( 2m ) 상의 유한체 승산기 설계 및 비교 ( A Design and Comparison of Finite Field Multipliers over GF ( 2m ) )
전자공학회논문지-B
1991 .10
Analysis on Full Adder with Restoring Function in Nominal and Low Supply Voltage
대한전자공학회 학술대회
2017 .01
Bfloat16 수 체계 기반의 adder와 multiplier의 성능 분석
대한전자공학회 학술대회
2019 .11
ROM 구조를 갖는 전류방식 COMS 회로에 의한 GF ( 2m ) 상의 연산기 설계 ( A Design of Adder and Multiplier on GF ( 2m ) Using Current Mode CMOS Circuit with ROM Structure )
전자공학회논문지
1988 .10
유한체 GF ( 2m ) 상의 승산기 구조에 관한 연구 ( A Study on Construction of the Multiplier Over Finite Field GF ( 2m ) )
대한전자공학회 학술대회
1992 .07
정확도를 높인 Approximate Adder 설계
대한전자공학회 학술대회
2020 .08
정수 선형 프로그래밍을 이용한 혼합 가산기 구조의 최적 설계
정보과학회논문지 : 시스템 및 이론
2007 .08
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