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논문 기본 정보
- 자료유형
- 학술대회자료
- 저자정보
- 발행연도
- 2008.11
- 수록면
- 444 - 447 (4page)
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This paper describes a spread spectrum clock generator (SSCG) for the DisplayPort transmitter system. The proposed architecture generates the spread spectrum clock using a fractional-N PLL. The SSCG uses a digital 2nd order MASH 1-1 sigma-delta modulator and 9bit Up/Down counter. The SSCG generates clocks at 270MHz and 162MHz with 0.25% down-spreading with triangular waveform frequency modulation of 33 KHz for DisplayPort transmitter system. And the peak power reduction is about 5dBm. The circuit has been simulated in 0.18um CMOS technology.
목차
Abstract
Ⅰ. INTRODUCTION
Ⅱ. PROPOSED SSCG ARCHITECTURE
Ⅲ. SIMULATION OF THE PROPOSED SSCG
Ⅳ. CONCLUSION
ACKNOWLEDGEMENT
REFERENCES
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