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대한전자공학회 전자공학회논문지-SD 電子工學會論文誌 第47卷 SD編 第2號
발행연도
2010.2
수록면
21 - 31 (11page)

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본 논문에서는 DisplayPort용 전자기기 또는 클록 발생을 요구하는 다양한 회로에서 발생 할 수 있는 전자방해(EMI) 현상을 줄일 수 있는 위상 동기 루프와 확산 대역 클록 발생기를 구현 하였다. 이 시스템은 기본적으로 송신용 위상 동기 루프와 확산 대역 클록 발생기 구현을 위한 전하펌프2 와 기준주파수 분주기 등으로 구성된다. 본 논문에서는 2.7Gbps/1.62Gbps DisplayPort 응용 회로에 적합 하도록 10개의 다중 위상 신호를 출력 할 수 있는 270㎒/162㎒ 듀얼 모드 위상 동기 루프를 설계 하였고 추가적으로 1.35㎓/810㎒의 위상 동기 루프를 설계하여 지터를 크게 감소시킬 수 있는 구조를 제안하였다. 270㎒/162㎒ 위상 동기 루프와 5:1 시리얼라이저 2개, 그리고 1.35㎓ 위상 동기 루프와 2:1 시리얼라이저를 연동함으로써 지터 성분을 크게 줄일 수 있다. 위상 동기 루프에서 사용 된 주파수 전환 다중위상 전압제어 발진기와 더불어 DisplayPort 규격에 맞는 주파수 전환이 가능 하도록 분주기를 공유하고 50% duty ratio를 보장할 수 있는 주파수 분주기 구조를 제안 하였다. 또한, 지터를 줄이기 위해서 출력전류 오차를 크게 줄일 수 있는 전하펌프 구조를 제안 하였다. 0.13 ㎛ CMOS 공정을 사용하여 설계 하였으며, 270㎒/162㎒ PLL의 칩 면적은 650㎛ × 500㎛ 이고, 1.35㎓/810㎒ PLL의 칩 면적은 600㎛ × 500㎛ 이다. 270㎒/162㎒ 위상 동기 루프 전압제어 발진기의 조절 범위는 330㎒이고, 위상 잡음은1㎒ 오프셋에서 -114cBc/㎐, 확산대역 클록 발생기의 확산 진폭도 는 0.5%이고, 변조 주파수는 31㎑이다. 전체 전력 소모는 48㎽이다.

목차

요약
Abstract
Ⅰ. 서론
Ⅱ. 본론
Ⅲ. 실험결과
Ⅳ. 결론
Acknowledgement
참고문헌
저자소개

참고문헌 (13)

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