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2nd-ΣΔ 변조기를 이용한 DisplayPort용 Stream Clock Recovery 회로 구현
대한전자공학회 학술대회
2009 .07
A 1.62/2.7/5.4 Gbps Clock and Data Recovery Circuit for DisplayPort 1.2 with a single VCO
JOURNAL OF SEMICONDUCTOR TECHNOLOGY AND SCIENCE
2013 .06
이중 보간 방식을 이용한 CMOS 클록 데이터 복원회로
대한전자공학회 학술대회
2009 .07
Referenceless Clock and Data Recovery algorithm for DisplayPort v1.2
대한전자공학회 ISOCC
2012 .11
A 2.7Gbps & 1.62Gbps Dual-Mode Clock and Data Recovery for DisplayPort
대한전자공학회 ISOCC
2008 .11
A New Burst Mode Clock and Data Recovery Circuit
대한전자공학회 ISOCC
2007 .10
A 5-Gb/s Half-Rate Clock Recovery Circuit
대한전자공학회 ISOCC
2006 .10
Design of Clock Gears for Low-power Media Bus
ITC-CSCC :International Technical Conference on Circuits Systems, Computers and Communications
2008 .07
Variable Rate Clock and Data Recovery Circuit for Biomedical Application
대한전자공학회 ISOCC
2012 .11
Spread Spectrum Clock Generator for DisplayPort
대한전자공학회 ISOCC
2008 .11
A 0.18-μm CMOS, 10-Gb/s Injection-Locked Clock and Data Recovery Circuit
대한전자공학회 ISOCC
2007 .10
A 5-Gb/s Half-rate Clock Recovery Circuit in 0.25-μm CMOS Technology
대한전자공학회 ISOCC
2006 .10
결합 보간 필터를 이용한 QSPK Clock Recovery 회로 ( A QPSK clock recovery circuit based on a combined filter )
한국통신학회논문지
2001 .06
광대역 전디지털 클록 데이터 복원회로 설계
전기학회논문지
2012 .11
A 40 Gb/s Clock and Data Recovery Module with Improved Phase-Locked Loop Circuits
[ETRI] ETRI Journal
2008 .04
Design Methodologies for Reliable Clock Networks
Journal of Computing Science and Engineering
2012 .12
Clock Design Techniques Considering Circuit Reliability
대한전자공학회 ISOCC
2011 .11
Design and Characterization of a 10 Gb/s Clock and Data Recovery Circuit Implemented with Phase-Locked Loop
[ETRI] ETRI Journal
1999 .06
안전한 MCU 클럭 보호를 위한 온칩 클럭 검사기 기반 자동화된 글리치 프리 백업 클럭 변환 기법
대한전자공학회 학술대회
2015 .06
100Mb/s~3Gb/s 전디지털 클록 데이터 복원회로 설계
대한전자공학회 학술대회
2012 .11
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