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논문 기본 정보

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대한전자공학회 전자공학회논문지-SD 電子工學會論文誌 SD編 第46卷 第3號
발행연도
2009.3
수록면
69 - 74 (6page)

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우리는 fixed priority 방식에서 나타나는 스타베이션 현상 방지와 각 마스터들에게 우선순위대로 효율적으로 버스 점유권을 할당하도록 하는 fixed priority 방식과 round-robin 방식을 혼재한 하이브리드 중재 방식을 제안하였다. 제안한 중재방식과 기존의 중재방식은 Verilog와 하이닉스 0.18㎛ 기술의 설계라이브러리를 통해 수행되었으며, 게이트 수와 설계 오버헤드를 비교하였다. 성능 분석 결과, 설계 복잡도, 타이밍 마진, 버스 점유율, 스타베이션 방지, 요청사이클 등에서 하이브리드 중재 방식이 다른 중재방식보다 성능이 우수하였음을 확인하였다.
#Arbitration #starvation #bus architecture

목차

요약
Abstract
Ⅰ. 서론
Ⅱ. RTL 설계 및 분석
Ⅲ. 성능분석
Ⅳ. 결론
참고문헌
저자소개

참고문헌 (7)

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1. [학술지(정기간행물)] - L. Benini / 2002 / Networks on chips:A new SoC paradigm / IEEE Comput. 35 : 70 ~ 78 google schola 2. [학술지(정기간행물)] - M. Jun / 2007 / Latency-aware bus arbitration for real-time embedded systems / IEICE Trans. Inf.& Syst. E90-D (3) google schola 3. [학술대회논문] - Y. Xu / 2006 / An Adaptive Dynamic Arbiter for Multi-Processor SoC / Solid-State and Integrated Circuit Technology International Conf. : 1993 ~ 1996 google schola 4. [학술대회논문] - A. Bystrov / 2000 / Priority Arbiters / in Proc. IEEE 6th internation Symp. ASYNC : 128 ~ 137 google schola 5. [학술지(정기간행물)] - K. Lahiri / 2006 / The LOTTERYBUS On-Chip Communication Architecture / IEEE Trans. VLSI Systems 14 (6) google schola

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