하이브리드 버스 중재 방식

이국표; 윤영섭

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자료유형: 학술저널

저자정보: 이국표 윤영섭

저널정보: 대한전자공학회 전자공학회논문지-SD 電子工學會論文誌 SD編第46卷第2號

발행연도: 2009.2

수록면: 50 - 56 (7page)

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SoC(System on Chip)는 버스 아키텍처 안에 여러 개의 마스터, 슬레이브, 아비터 그리고 디코더로 구성되어 있다. 마스터는 CPU, DMA, DSP 등과 같이 데이터 트랜잭션을 발생시키는 블록이고, 슬레이브는 SRAM, SDRAM, 레지스터 등과 같이 데이터 트랜잭션에 응답하는 블록이다. 또한 아비터는 마스터가 동시간대에 버스를 이용할 수 없기 때문에 이를 중재하는 역할을 수행하는데, 어떠한 중재 방식을 선택하는가에 따라 SoC의 성능이 크게 바뀔 수 있다. 일반적인 중재 방식에는 fixed priority 방식, round-robin 방식, TDM 중재 방식 등이 있다. 본 논문에서는 TLM 알고리즘을 구성하여 일반적인 중재방식을 TLM 시뮬레이션을 통해 비교 분석하였다. 또한 새로운 중재 방식인 하이브리드 버스 중재 방식을 제안하고 다른 중재 방식과 비교하여 성능을 검증하였다.

#SoC #bus architecture #transaction #arbitration #fixed priority #round-robin #performance

참고문헌 (7)

참고문헌 신청

1. [단행본] - K. Lee / 2007 / Architecture Exploration for Performance Improvement of SoC Chip Based on AMBA System / ICCIT : 739 ~ 744

2. [보고서] - Gunar Schirner / 2005 / System Level Modeling of an AMBA Bus

3. [기타자료] - / 1999 / AMBA TM Specification(AHB) (Rev 2.0) / ARM

4. [학술지(정기간행물)] - K. Lahiri / 2006 / The LOTTERYBUS On-Chip Communication Architecture / IEEE Trans. VLSI Systems 14 (6)

5. [학술대회논문] - Y. Xu / 2006 / An Adaptive Dynamic Arbiter for Multi-Processor SoC / Solid-State and Integrated Circuit Technology International Conf. : 1993 ~ 1996

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이 논문의 저자 정보

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