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논문 기본 정보
- 자료유형
- 학술저널
- 저자정보
- 발행연도
- 2008.4
- 수록면
- 21 - 26 (6page)
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본 논문에서는 Instantaneous locking 특성을 갖는 새로운 구조의 수동형 광가입자망용 622Mbps급 버스트모드 클럭/데이터 복원회로를 제안하고, 이를 구현하였다. 이 회로는 고속 클럭신호를 발생하는 위상고정루프 와 버스트모드에서의 클럭/데이터 복원회로 두 개의 블럭으로 구성되어 있다. 클럭/데이터 복원회로 에서는 위상고정루프의 클럭을 지연소자를 통해 7개의 서로 다른 클럭신호로 발생시킨다. 이 경우 광가입자망에 지터를 가지고 있는 신호가 입력되어도 항상 데이터의 중앙에 클럭이 정렬되도록 조정하여 최적의 샘플링 시점에서 데이터를 복원하게 된다. 제안한 구조에 대한 검증을 위하여 0.35um n-well CMOS 공정을 이용하여 회로의 동작을 확인하였다.
목차
요약
Abstract
Ⅰ. 서론
Ⅱ. CDR 회로의 구성과 동작원리
Ⅲ. 설계된 회로의 시뮬레이션 결과
Ⅳ. 결론
참고문헌
저자소개
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2. [학술지(정기간행물)] - Jae-Wook Lee / 2001 / A Giga-bps Clock and Data Recovery Circuit with a new Phase Detector / 한국통신학회 126 (6B) : 848 ~ 855
3. [학술대회논문] - S. Gegaert / 1997 / A skew tolerant CMOS level-based ATM data-recovery system without PLL topology / IEEE 1997 Custom Integrated Circuits Conference : 453 ~ 456
4. [학술대회논문] - Kim. B. / 1990 / A 30MHz high-speed analog/digital PLL in 2um CMOS / Solid-State Circuits Conference : 104 ~ 105
5. [학술지(정기간행물)] - M. Banu / 1992 / Clock recovery circuits with instantaneous locking / Electron. Lett 28 (23) : 2127 ~ 2130
2. [학술지(정기간행물)] - Jae-Wook Lee / 2001 / A Giga-bps Clock and Data Recovery Circuit with a new Phase Detector / 한국통신학회 126 (6B) : 848 ~ 855
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