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논문 기본 정보
- 자료유형
- 학술저널
- 저자정보
- 발행연도
- 2002.3
- 수록면
- 39 - 47 (9page)
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본 논문에서는 전류모드 CMOS를 통한 GF(3m)상의 표준기저 승산회로를 제안하였다. 먼저, GF(3)연산을 위해 필요한 가산 및 승산을 진리표를 통해 정의하고 이를 CMOS회로로 설계하였다. GF(3m)상의 임의의 두 원소들간의 승산의 전개방식을 수식을 통해 보였으며, 정의된 3치 기본연산자를 조합하여 GF(3m) 승산회로를 설계하였다. 제안된 수식과 회로를 m에 대하여 일반화하였고, 그 중 m=3에 대한 설계의 예를 보였다. 본 논문에서 제안된 승산회로는 그 구성이 블록의 형태로 이루어지므로 m에 대한 확장이 용이하며, VLSI에 유리하다. 또한 회로내부에 메모리소자를 사용하지 않고, 연산디지트들이 병렬로 연산되므로 빠른 연산이 가능하다. 제안된 회로의 논리연산동작을 시뮬레이션을 통해 검증하였다.
목차
Ⅰ. 서론
Ⅱ. GF(3＾m)상의 승산의 전개
Ⅲ. GF(3＾m)상의 승산회로의 구성
Ⅳ. 전류모드 CMOS를 사용한 GF(3＾m) 승산기 설계
Ⅴ. 결론
참고문헌
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