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논문 기본 정보
- 자료유형
- 학술대회자료
- 저자정보
- 발행연도
- 2010.11
- 수록면
- 338 - 341 (4page)
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A 7b 1GS/s CMOS folding ADC is presented. It utilizes improved track-and-hold circuit using simple clock generator and bootstrapped sampling switch, sequential amplifier settling method in amplifier chain. It also uses low-power thermometer-to-binary encoder realized with transmission gate multiplexer and intermediate track-and-hold circuit for high-speed medium-resolution A/D conversion. The proposed ADC achieves about 6.5 effective bits for 250MHz input at 1GS/s. It consumes 60mW from 1.2V single supply. It is fabricated with 65nm LP CMOS process occupying 0.2㎟ active area.
목차
Abstract
Ⅰ. INTRODUCTION
Ⅱ. THE PROPOSED 7BIT 1GSPS FOLDING ADC
Ⅲ. MEASURED RESULTS
Ⅳ. CONCLUSION
REFERENCES
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