0.18μm로 설계된 저전력 완전차동구조 CMOS TIA

하기혁; 강진구

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자료유형: 학술대회자료

저자정보: 하기혁 (인하대학교) 강진구 (인하대학교)

저널정보: 대한전자공학회 대한전자공학회 학술대회 2007년도 SOC 학술대회

발행연도: 2007.5

수록면: 134 - 137 (4page)

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이 논문에서는, CMOS 0.18μm의 공정으로 차동구조 TIA를 설계하였다. 제안된 TIA는 입력단과 inverter 이득단, 완전차동 구조 증폭기로 이루어져 있으며 ESD와 PD에 의한 기생 커패시턴스의 영향에 둔감하면서 이득을 최대화하였다. 3.125Gbps의 대역폭을 갖고 70dBΩ의 이득을 얻는 차동구조의 TIA는 6.5mW의 전력을 소모한다. 고속에서 대역폭을 넓히기 위해 사용되는 인덕터를 사용하지 않음으로써 칩 면적을 줄일 수 있다.

#transimpedance amplifier #differential structure #optical receivers #CMOS technology

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