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논문 기본 정보
- 자료유형
- 학술대회자료
- 저자정보
- 발행연도
- 2024.11
- 수록면
- 199 - 203 (5page)
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This paper presents an SRAM-based ChaCha20 Computing-in-Memory (CIM) encryption processor designed for low-power environments, such as IoT devices. The proposed processor efficiently generates the ChaCha20 keystream for lightweight 128-bit input processing. Logic operations are performed at the column level using 10T SRAM cells, while a system clock-based Rotation Unit enables efficient bit-level and word-level shifts across columns. The proposed system operates at a maximum frequency of 125 MHz with a 1.8V supply in 180nm TSMC CMOS technology, achieving energy consumption of 4.56 pJ/b, making it a highly efficient solution for low-power applications.
목차
Abstract
I. 서론
II. 이론적 배경
III. 제안하는 SRAM 기반 CIM 구조
IV. 실험 및 결과
V. 결론 및 향후 연구 방향
참고문헌
참고문헌 (0)
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