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논문 기본 정보

자료유형
학술저널
저자정보
황준호 (성균관대학교) 서문교 (성균관대학교)
저널정보
한국전자파학회 한국전자파학회논문지 한국전자파학회논문지 제35권 제11호(통권 제330호)
발행연도
2024.11
수록면
880 - 887 (8page)

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본 논문에서는 40-nm CMOS 공정을 이용한 차동 공통 소스 구조를 이용한 106∼133 GHz 광대역 전력 증폭기를 제시한다. 출력을 제외한 각 증폭단은 직렬 인덕터를 추가한 광대역 트랜스포머를 통해 정합하였고, 출력은 발룬을 통해 최대 출력 부하 임피던스에 정합하였다. 측정 결과, 증폭기의 최대 이득은 116 GHz에서 22.3 dB, 3-dB 대역폭은 27 GHz, 출력 포화전력은 9.4 dBm이다. 소비 전력은 1.1 V 공급 전압에서 76 mW, 최대 전력 부가 효율은 9.3 %이다. 패드를 제외한 칩 면적은 595 μm×88 μm이다.

목차

요약
Abstract
Ⅰ. 서론
Ⅱ. 광대역 전력 증폭기 구성 및 설계
Ⅲ. 측정 결과
Ⅳ. 결론
References

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