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박도원 (경북대학교) 문휘수 (경북대학교) 박윤진 (경북대학교) 안희균 (경북대학교) 이주형 (경북대학교) 정성윤 (경북대학교) 심재훈 (경북대학교)
저널정보
대한전자공학회 대한전자공학회 학술대회 2024년도 대한전자공학회 하계학술대회 논문집
발행연도
2024.6
수록면
1,014 - 1,018 (5page)

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본 논문에서는 내 칩 (MyChip) 제작 서비스를 통해 ETRI 0.5um CMOS 공정으로 구현한 PLL을 소개한다. PLL은 88MHz의 출력 주파수, 100kHz의 대역폭, 그리고 50us의 Locking time을 갖도록 설계되었다. ETRI 0.5um 공정을 이용하여 PLL을 설계할 때 고려할 점에 대해 논의하며, Post-layout Simulation 결과를 제시한다. 측정 결과는 학회에서 발표할 수 있을 것으로 예상된다.

목차

Abstract
Ⅰ. 서론
Ⅱ. 본론
Ⅲ. 구현
Ⅳ. 결론
참고문헌

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