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논문 기본 정보
- 자료유형
- 학술대회자료
- 저자정보
- 발행연도
- 2023.6
- 수록면
- 531 - 535 (5page)
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It is hard to resolve the nonlinearity issue caused by the mismatch of bridge capacitor for split successiveapproximation-resistor (SAR) analog-to-digital converters (ADCs). Furthermore, the nonlinearity introduced by capacitor mismatch in the SAR ADCs affects more series problem on the ADC performance. This paper proposes a design method of a split SARADC with a background calibration to overcome both nonlinearities caused by the mismatches of a bridge capacitor as well as a binary-weighted capacitors. In this work, the same input signal is converted twice with additional capacitor, based on the perturbation manner. Then, the errors are calculated and those are alleviated in digital processing. The behavioral simulation results with the proposed 10bit split SAR ADC showed the enhanced DNL and INL as 0.69LSB and 0.75LSB, respectively. The SNDR and SFDR are improved by 4.72dB and 6.3dB, respectively.
목차
Abstract
Ⅰ. 서론
Ⅱ. Nonlinearity in Split-SAR ADC
Ⅲ. Architecture
Ⅳ. Perturbation Based Calibration
Ⅴ. 시뮬레이션 결과
Ⅵ. 결론 및 향후 연구 방향
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