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저자정보
서기덕 (The Catholic University of Korea) 임준범 (The Catholic University of Korea) 정승하 (The Catholic University of Korea) 박태근 (The Catholic University of Korea)
저널정보
대한전기학회 전기학회논문지 전기학회논문지 제72권 제7호
발행연도
2023.7
수록면
855 - 862 (8page)
DOI
10.5370/KIEE.2023.72.7.855

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In this paper, the error rate was reduced by using a calibration algorithm that can correct errors that occur in the initial disparity calculation stage using adaptive support-weights. Performance can be further improved by overlapping the initial disparity calculation and the disparity calibration stages. Because the adaptive support-weight algorithm includes nonlinear functions, it is impossible to reuse already processed data. In this study, it is designed to reuse data by separating rows and columns, and as a result, performance is improved and real-time processing is possible. To optimize the delay path, the exponential function is approximated with a step function, and a 5-stage pipeline is applied to the division operation. The proposed architecture was designed using VerilogHDL and synthesized with DBhitek 110nm standard cell library. The synthesized system used a maximum frequency of 666MHz (57fps) with 33K gates, and a memory of 4.9KB, and showed an error rate of 1.88% for tsukuba image.
#stereo vision #realtime system #adaptive support-weight #disparity calibration #VLSI design

목차

Abstract
1. 서론
2. 적응적 영역 가중치와 disparity calibration
3. 제안한 스테레오 비전 시스템 구조
4. 데이터 스케쥴링
5. 성능 분석
6. 결론
References

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