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이용수
Abstract
I. 서론
II. 본론
Ⅲ. 결론
참고문헌
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스케일링 및 데이터 보존을 위한 2단자 사이리스터 랜덤 액세스 메모리 (T-RAM) 특성 분석
대한전자공학회 학술대회
2020 .08
2단자 사이리스터를 기반으로 하는 TRAM 메모리 소자의 축소화와 1 V 이하 저전압 동작 특성
대한전자공학회 학술대회
2016 .11
축소화된 2단자 TRAM 메모리 소자의 쓰기 동작 최적화
대한전자공학회 학술대회
2016 .11
메모리 셀의 데이터 리텐션 시간 시뮬레이션을 통한 임베디드 디램의 최대 용량 계산
대한전자공학회 학술대회
2023 .06
점진적 상태 변화 특성을 갖는 수직 채널 구조의 Si/SiGe 이종접합 2단자 사이리스터 동적 랜덤 액세스 메모리
대한전자공학회 학술대회
2020 .11
메모리 접근 경향을 고려한 적응적 DRAM Refresh
대한전자공학회 학술대회
2016 .06
Poly-Si 1T-DRAM의 Array 구조에서의 Disturbance 특성 분석
대한전자공학회 학술대회
2021 .06
Extension of DRAM Retention Time at 77 Kelvin by Replacing Weak Rows with Large GIDL Current
JOURNAL OF SEMICONDUCTOR TECHNOLOGY AND SCIENCE
2022 .06
Write Disturbance Error-reduction Schemes : A Survey
IEIE Transactions on Smart Processing & Computing
2018 .04
An Approximate DRAM Design with an Adjustable Refresh Scheme for Low-power Deep Neural Networks
JOURNAL OF SEMICONDUCTOR TECHNOLOGY AND SCIENCE
2021 .04
비파괴적 읽기 동작이 가능한 컴팩트 2T(0C) DRAM 셀의 설계와 시냅스 소자 응용 가능성
대한전자공학회 학술대회
2021 .06
인공지능 반도체 메모리 기술 동향
[ETRI] 전자통신동향분석
2024 .10
A Logic-compatible Embedded DRAM Utilizing Common-body Toggled Capacitive Cross-talk
JOURNAL OF SEMICONDUCTOR TECHNOLOGY AND SCIENCE
2016 .12
트랜지스터의 온도 계수를 고려한 커패시터리스 디램의 설계 최적화
전기전자학회논문지
2024 .09
정확한 메모리 간섭 딜레이 분석을 위한 메모리 액세스 패턴 기반 DRAM 분할 기법
한국정보과학회 학술발표논문집
2016 .06
1T DRAM with Raised SiGe Quantum Well for Sensing Margin Improvement
JOURNAL OF SEMICONDUCTOR TECHNOLOGY AND SCIENCE
2023 .02
Investigation of Modified 1T DRAM with Twin Gate Tunneling Field Effect Transistor for Improved Retention Characteristics
JOURNAL OF SEMICONDUCTOR TECHNOLOGY AND SCIENCE
2020 .04
DRAM의 성능 향상을 위한 Pre-Refresh 기법
한국정보기술학회논문지
2018 .10
DRAM 캐시를 포함하는 이종 메모리 시스템을 위한 성능 분석 환경
대한전자공학회 학술대회
2017 .11
차세대 비휘발성 메모리 Crossbar Array Architecture의 읽기 기준 전압과 Array 사이즈에 따른 누설전류 및 소비전력 분석
대한전자공학회 학술대회
2018 .06
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