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논문 기본 정보
- 자료유형
- 학술저널
- 저자정보
- 저널정보
- Korean Institute of Information Scientists and Engineers Journal of Computing Science and Engineering Journal of Computing Science and Engineering Vol.14 No.3
- 발행연도
- 2020.9
- 수록면
- 89 - 101 (13page)
- DOI
- 10.5626/JCSE.2020.14.3.89
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Time predictability is crucial for hard real-time and safety-critical systems. In an integrated CPU-GPU (graphic processing units) architecture, the shared last-level cache (LLC) can cause a large number of interferences between CPU and GPU LLC accesses with diverse patterns and characteristics, which can significantly impact the performance and time predictability of both CPUs and GPUs. In this paper, we explore cache partitioning, locking, and a combination of them to make the LLC time-predictable for integrated CPU-GPUs while achieving high performance. By evaluating these LLC management approaches, we can provide real-time system developers recommendations on the most effective time-predictable LLC designs for heterogeneous CPU-GPU multicore processors.
목차
Abstract
I. INTRODUCTION
II. RELATED WORK
III. MOTIVATION
IV. TIME-PREDICTABLE LLC DESIGN OPTIONS
V. EVALUATION METHODOLOGY
VI. EXPERIMENTAL RESULTS
VII. CONCLUSION
REFERENCES
참고문헌 (36)
참고문헌 신청
G. A. Elliott, B. C. Ward, and J. H. Anderson, “GPUSync: a framework for real-time GPU management,” in Proceedings of 2013 IEEE 34th Real-Time Systems Symposium, Vancouver, Canada, 2013, pp. 33-44.
L. Thiele and R. Wilhelm, “Design for timing predictability,” Real-Time Systems, vol. 28, no. 2-3, pp. 157-177, 2004.
C. Berg, J. Engblom, and R. Wilhelm, “Requirements for and design of a processor with predictable timing,” in Perspectives Workshop: Design of Systems with Predictable Behaviour. Dagstuhl, Germany: Internationales Begegnungsund Forschungszentrum fur Informatik (IBFI), 2004.
V. Suhendra and T. Mitra, “Exploring locking & partitioning for predictable shared caches on multi-cores,” in Proceedings of the 45th Annual Design Automation Conference, Anaheim, CA, 2008, pp. 300-303.
M. Paolieri, E. Quinones, F. J. Cazorla, G. Bernat, and M. Valero, “Hardware support for WCET analysis of hard real-time multicore systems,” ACM SIGARCH Computer Architecture News, vol. 37, no. 3, pp. 57-68, 2009.
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