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논문 기본 정보
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- 학술대회자료
- 저자정보
- 저널정보
- 한국정보디스플레이학회 한국정보디스플레이학회 International Meeting 한국정보디스플레이학회 2007년도 7th International Meeting on Information Display 제7권1호
- 발행연도
- 2007.1
- 수록면
- 802 - 805 (4page)
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A hardware architecture is presented of a wavelet based multiple line addressing driving scheme for passive matrix displays using the FPGA (Field Programmable Gate Arrays), which will be integrated in the scalable video coding $architecture^{[1]}$. The incoming compressed video data stream will then directly be transformed to the required column voltages by the hardware architecture without the need of employing the video decompression.
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