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저자정보
Anıl Çelebi (Kocaeli University) Sarp Erturk (Kocaeli University) Hyuk Jae Lee (서울대학교)
저널정보
대한전자공학회 ITC-CSCC :International Technical Conference on Circuits Systems, Computers and Communications ITC-CSCC : 2009
발행연도
2009.7
수록면
1,297 - 1,299 (3page)

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This paper presents an architecture design for low complexity motion estimation (ME) approaches. The bit-plane based modular structure of the proposed architecture is easily reconfigurable according to the ME method to be used. The comparatively high memory size required in previously proposed architectures is reduced by utilizing a 2D processing element (PE) architecture instead of a 1D sy ... 전체 초록 보기
#Motion estimation #hardware architecture #bit plane matching #array processors #data reuse

목차

Abstract
1. Introduction
2. Bit plane matching
3. Hardware architecture
4. Conclusion
References

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