HEVC CABAC 복호화기의 역이진화기 설계

김두환; 김소현; 이성수

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자료유형: 학술저널

저자정보: 김두환 (Soongsil University) 김소현 (Soongsil University) 이성수 (Soongsil University)

저널정보: 한국전기전자학회 전기전자학회논문지 전기전자학회논문지 제20권 제3호

발행연도: 2016.9

수록면: 326 - 329 (4page)

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HEVC CABAC 부호화기에서는 이진 산술 부호화를 수행하기 전에 구문 요소를 이진 값으로 변환하는 과정이 선행된다. 따라서 HEVC CABAC 복호화기에서도 이진 산술 복호화기를 통해 이진 값으로 나타낸 구문 요소들을 원래의 값으로 역이진화 하는 역이진화기를 필요로 한다. 본 논문에서는 구문 요소의 종류를 파악하여 이진 값의 병합을 수행하는 제어기와, 제어기로부터 병합된 이진 값을 원래의 구문 요소로 변환시키는 엔진으로 구성된 역이진화기의 구조를 제안하고 이를 구현하였다. 설계된 역이진화기는 Verilog HDL로 기술하고 0.18㎛ 공정에서 합성 및 검증하였으며, 하드웨어 크기는 3,114 게이트이고 최대 동작 속도는 220 ㎒이다.

#HEVC #CABAC #Decoder #De-Binarizer #Syntax Element

참고문헌 (7)

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[학술지(정기간행물)] - G. Sullivan / 2012 / Overview of the High Efficiency Video Coding (HEVC) Standard / IEEE Trans. Circuits Syst. Video Technol 22 (15) : 1649 ~ 1668

[학술지(정기간행물)] - Duyen Hai Pham / 2014 / Hardware Implementation of HEVC CABAC Binarizer / 전기전자학회논문지 18 (3) : 356 ~ 361

[학술지(정기간행물)] - Duyen Hai Pham / 2014 / Hardware Implementation of HEVC CABAC Binary Arithmetic Encoder / 전기전자학회논문지 18 (4) : 630 ~ 635

[학술지(정기간행물)] - 김두환 / 2015 / HEVC CABAC 문맥 모델러의 하드웨어 구현 / 전기전자학회논문지 19 (2) : 254 ~ 259

[학술지(정기간행물)] - 김두환 / 2015 / 우회 빈의 병렬처리가 가능한 HEVC CABAC 부호화기의 설계 / 전기전자학회논문지 19 (4) : 583 ~ 589

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