HEVC CABAC 문맥 모델러의 하드웨어 구현

김두환; 문전학; 이성수

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자료유형: 학술저널

저자정보: 김두환 문전학 이성수

저널정보: 한국전기전자학회 전기전자학회논문지 전기전자학회논문지 제19권 제2호

발행연도: 2015.6

수록면: 254 - 259 (6page)

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CABAC은 문맥 기반 적응적 이진 산술 부호화 방식으로, 이전까지 부호화 된 심볼들의 정보를 이용하여 확률을 업데이트하여 부호화 효율을 높이는 기법이다. 문맥 모델러는 통계적 상관성을 고려하여 심볼에 따라 확률 모델을 설계하는 CABAC의 핵심 블록으로서, 본 논문에서는 문맥 모델러의 효율적인 하드웨어 아키텍쳐를 제안한다. Verilog HDL로 기술되어 0.18 um 공정으로 설계된 문맥 모델러는 메모리를 포함하여 29,832개의 게이트로 이루어져 있으며, 최대 동작속도는 200 MHz, 최대 처리율은 200 Mbin/s이다.

#CABAC #context modeler #hardware #HEVC #implementation

참고문헌 (7)

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[기타자료] - B. Bross / 2013 / JCTVC-L1003_v34 : High efficiency video coding(HEVC)text specification draft 10 / Joint Collaborative Team on Video Coding(JCT-VC)

[인터넷자원] - / / HEVC software repository HM-11 reference model

[학술지(정기간행물)] - 한승목 / 2013 / 저면적 HEVC 코어 변환기 아키텍쳐 설계 / 전기전자학회논문지 17 (2) : 119 ~ 128

[학술지(정기간행물)] - 이종배 / 2013 / 곱셈기를 재사용하는 8×8 HEVC 코어 역변환기 설계 / 전기전자학회논문지 17 (4) : 570 ~ 578

[학술대회논문] - B. Peng / 2013 / A hardware CABAC encoder for HEVC / IEEE International Symposium on Circuits and Systems : 1372 ~ 1375

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김두환

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문전학

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이성수

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