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논문 기본 정보
- 자료유형
- 학술저널
- 저자정보
- 발행연도
- 2013.6
- 수록면
- 119 - 128 (10page)
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본 논문에서는 차세대 동영상 압축 표준인 HEVC의 핵심 프로세스 중 하나인 코어 변환기를 설계하고 이를 합성한 후 검증하였다. 제안하는 코어 변환기는 면적을 많이 차지하는 곱셈기 대신에 덧셈기와 쉬프터만을 사용하였으며, 쉬프터도 실제로는 와이어 연결과 멀티플렉서만을 사용하여 면적을 크게 줄였다. 또한 하나의 하드웨어로 4×4에서 16×16 블록까지 모두 처리할 수 있도록 설계하였으며, 이를 위해서 연산처리기를 재사용하는 아키텍쳐를 제안하였다. 0.13um 공정으로 설계된 코어 변환기는 16×16 블록을 2-D 변환 처리하는데 160 사이클이 소요되며 게이트 수는 101,015 게이트이다.
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1. [학술지(정기간행물)] - T. Wiegand / 2003 / Overview of the H. 264/AVC Video Coding Standard / IEEE Transactions on Circuits and Systems for Video Technology 13 (7) : 560 ~ 576
2. [학술지(정기간행물)] - 정준모 / 2010 / GP-GPU를 이용한 H.264／AVC 디코더의 IQ/IDCT구현 / 전기전자학회논문지 14 (2) : 150 ~ 155
3. [학술지(정기간행물)] - 이찬호 / 2009 / 이중 채널 파이프라인 구조의 H.264용 고성능 보간 연산기 설계 / 전기전자학회논문지 13 (4) : 110 ~ 115
4. [학술지(정기간행물)] - G. Sullivan / 2012 / Overview of the High Efficiency Video Coding(HEVC)Standard / IEEE Transactions on Circuits and Systems for Video Technology 22 (12) : 1649 ~ 1668
5. [보고서] - A. Fuldseth / 2011 / CE10: Core Transform Design for HEVC
2. [학술지(정기간행물)] - 정준모 / 2010 / GP-GPU를 이용한 H.264／AVC 디코더의 IQ/IDCT구현 / 전기전자학회논문지 14 (2) : 150 ~ 155
3. [학술지(정기간행물)] - 이찬호 / 2009 / 이중 채널 파이프라인 구조의 H.264용 고성능 보간 연산기 설계 / 전기전자학회논문지 13 (4) : 110 ~ 115
4. [학술지(정기간행물)] - G. Sullivan / 2012 / Overview of the High Efficiency Video Coding(HEVC)Standard / IEEE Transactions on Circuits and Systems for Video Technology 22 (12) : 1649 ~ 1668
5. [보고서] - A. Fuldseth / 2011 / CE10: Core Transform Design for HEVC
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