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본 논문에서는 3치 논리 게이트를 바탕으로 하는 3치 데이터 처리를 위한 3치 flip-flop을 설계하였다. 제안한 flip-flop들은 3치 전압 모드 NMAX, NMIN, INVERTER 게이트를 사용하여 설계하였다. 또한 CMOS 기술을 사용하였고 다른 게이트들 보다 낮은 공급 전압과 낮은 전력소모 특성을 포함하고 있다. 제안한 회로는 0.35um 표준 CMOS 공정에서 설계되었고 3.3v의 공급 전압원을 사용하였다. 제안된 3치 flip-flop 구조는 3치 논리 게이트를 사용하여 VLSI 구현에 적합하고 높은 모듈성의 장점을 갖고 있다.
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[학술지(정기간행물)] - S.L. Hurst / 1984. / Multiple-valued logic Its status and its future c-22 : 1160 ~ 1179
[학술지(정기간행물)] - M. Davio / sept.1981. / Synthesis of discrete functions using I2L technology c-30 : 653 ~ 661
[학술지(정기간행물)] - Yasunori Nagata / 1997.05 / Design of an Asynchronous Digital System with B-ternary Logic : 256 ~ 271
[학술지(정기간행물)] - A.H. Shousha / 1995. / Switched current CMOS ternary logic circuits 79 (5) : 617 ~ 625
[학술지(정기간행물)] - Y.J. Chang / .1994.05 / Synthesis of multi-variable MVL functions using hybrid mode CMOS logic : 35 ~ 41
[학술지(정기간행물)] - M. Davio / sept.1981. / Synthesis of discrete functions using I2L technology c-30 : 653 ~ 661
[학술지(정기간행물)] - Yasunori Nagata / 1997.05 / Design of an Asynchronous Digital System with B-ternary Logic : 256 ~ 271
[학술지(정기간행물)] - A.H. Shousha / 1995. / Switched current CMOS ternary logic circuits 79 (5) : 617 ~ 625
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