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논문 기본 정보
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- 학술저널
- 저자정보
- 저널정보
- 대한전자공학회 JOURNAL OF SEMICONDUCTOR TECHNOLOGY AND SCIENCE Journal of Semiconductor Technology and Science Vol.15 No.5
- 발행연도
- 2015.10
- 수록면
- 504 - 510 (7page)
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This paper presents a power and area efficient SAR ADC for multi-channel near thresholdvoltage (NTV) applications such as neural recording systems. This work proposes a split dual-capacitivearray (S-DCA) structure with shifted input range for ultra low-switching energy and architecture of multichannel single-ended SAR ADC which employs only one comparator. In addition, the proposed ADC has the same amount of equivalent capacitance at two comparator inputs, which minimizes the kickback noise. Compared with conventional SAR ADC, this work reduces the total capacitance and switching energy by 84.8% and 91.3%, respectively.
목차
Abstract
Ⅰ. INTRODUCTION
Ⅱ. ARCHITECTURE
Ⅲ. CIRCUIT DESCRIPTION
Ⅳ. SIMULATED RESULTS
Ⅴ. CONCLUSIONS
REFERENCES
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[학술대회논문] - W. S. Liew / 2011 / A 0.5-V 1.13- uW/Channel Neural Recording Interface with Digital Multiplexing Scheme / Proc. ESSCIRC 2011 : 219 ~ 222
[학술대회논문] - Tai, H / 2014 / A 0.85 fJ/conversion-step 10b 200 kS/s subranging SAR ADC in 40 nm CMOS / IEEE ISSCC Dig. Tech. Pap : 196 ~ 197
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