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이용수
Abstract
1. 서론
2. 곱셈기의 구조
3. 곱셈기의 설계
4. 검증 및 구현
5. 결론
6. 참고문헌
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32비트와 16비트 명령을 갖는 RISC 코어의 설계 ( A Design of Rlsc Core With 32-Bit and 16-Bit Instructions )
대한전자공학회 학술대회
1997 .07
32 비트 DSP RISC 프로세서를 위한 ALU 설계 및 테스트
대한전자공학회 학술대회
1998 .11
32 비트 DSP RISC 프로세서를 위한 ALU 설계 및 테스트 ( ALU Design & Test for 32-bit DSP RISC Processors )
대한전자공학회 학술대회
1998 .11
신경회로망을 이용한 5 * 5 비트 곱셈기와 12 * 12 비트 곱셈기 설계 ( Designed of 5 * 5 bit multiplier and 12 *12 bit multiplier using of Neural Network )
대한전자공학회 학술대회
1989 .07
내장형 시스템에 적합한 32 비트 RISC/DSP 마이크로프로세서에 관한 연구
대한전자공학회 학술대회
1999 .06
32 비트 RISC/DSP CPU를 위한 고속 3 포트 레지스터 파일의 설계
대한전자공학회 학술대회
1998 .11
32 비트 RISC / DSP CPU를 위한 고속 3 포트 레지스터 파일의 설계 ( High Speed Triple-port Register File for 32-bit RISC / DSP Processors )
대한전자공학회 학술대회
1998 .11
16 비트 RISC 프로세서 설계 및 검증
대한전자공학회 학술대회
2008 .06
32 비트와 16 비트 명령을 갖는 RISC 코어의 설계
대한전자공학회 학술대회
1997 .06
저전력 32 비트 RISC 프로세서의 구조 설계
대한전자공학회 학술대회
1997 .06
32-비트 RISC 프로세서 제어부의 설계 ( 32-BIT RISC PROCESSOR CONTROL UNIT )
대한전자공학회 학술대회
1989 .07
32 비트 DSP 를 사용한 로보트 제어기의 개발 ( Robot Controller With 32-Bit DSP Chip )
대한전자공학회 학술대회
1991 .01
32-비트 RISC 마이크로 컨트롤러 설계
대한전자공학회 학술대회
2003 .07
유한체 GF(2m)상의 비트-병렬 곱셈기의 설계
한국정보통신학회논문지
2008 .07
16비트 DSP의 설계 및 FPGA 구현
대한전자공학회 학술대회
1996 .05
16비트 DSP의 설계 및 FPGA 구현 ( The design of 16 bit DSP and its Implementation with FPGA )
대한전자공학회 학술대회
1996 .01
32 비트 RISC/DSP 프로세서를 위한 곱셈기의 설계
Proceedings of KIIT Conference
2003 .08
H.264 에서 효율적인 비트율 제어를 위한 발생 비트 예측 알고리즘
한국통신학회 학술대회논문집
2006 .07
DSP 기능 유닛을 내장한 32비프 RlSC 마이크로프로세서의 구조 설게
대한전자공학회 학술대회
1999 .06
기가비트 통신 기술
[ETRI] 전자통신동향분석
1995 .03
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