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논문 기본 정보
- 자료유형
- 학술저널
- 저자정보
- 저널정보
- 대한전자공학회 IEIE Transactions on Smart Processing & Computing IEIE Transactions on Smart Processing & Computing Vol.4 No.2
- 발행연도
- 2015.4
- 수록면
- 83 - 88 (6page)
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Core-A is 32-bit synthesizable processor core with a unique instruction set architecture (ISA). In this paper, the Core-A ISA is introduced with discussion of useful features and the development environment, including the software tool chain and hardware on-chip debugger. Core-A is described using Verilog-HDL and can be customized for a given application and synthesized for an application-specific integrated circuit or field-programmable gate array target. Also, the GNU Compiler Collection has been ported to support Core-A, and various predesigned platforms are well equipped with the established design flow to speed up the hardware/software co-design for a Core-A?based system.
목차
Abstract
1. Introduction
2. Core-A Instruction Set Architecture
3. Core-A Hardware Implementation
4. Core-A Development Environment
5. Core-A Example Systems
6. Future Roadmap
7. Conclusion
References
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