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논문 기본 정보
- 자료유형
- 학술대회자료
- 저자정보
- 발행연도
- 2010.12
- 수록면
- 52 - 55 (4page)
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In this paper, an analog parallel processing circuit in the form of feed forward differential architecture is proposed to implement on analog PRML Viterbi decoder. It is based on the idea that the decoding of PRML is done mainly with the information of the first several number of stages. Several benefits including higher speed, no path memory, no trace back unit and no A/D converter are required for the decoding of the signals. Most of the conventional analog parallel processing-based PRML decoders are differential architecture with the feedback, where states are changed depending on the previous decoded data. The architecture used in this paper is without feedback, where error metric accumulation is allowed to start from odd and even input of subtrellis. It is simpler than that of the conventional analog parallel processing structure with similar decoding performance. The feature of proposed architecture is investigated through simulation results.
목차
Abstract
Ⅰ. INTRODUCTION
Ⅱ. PRPOSED ARCHITECTURE IN PR(1, 2, 2, 1)
Ⅲ. SIMULATION RESULTS
Ⅳ. CONCLUSION
REFERENCES
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