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학술저널
저자정보
마헤스워 샤퍄라 (전북대학교) 양창주 (전북대학교) 김형석 (전북대학교)
저널정보
대한전기학회 전기학회논문지 전기학회논문지 제59권 제8호
발행연도
2010.8
수록면
1,489 - 1,496 (8page)

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A feed forward differential architecture of analog PRML decoder is investigated to implement on analog parallel processing circuits. The conventional PRML decoder performs the trellis processing with the implementation of single stage in digital and its repeated use. The analog parallel processing-based PRML comes from the idea that the decoding of PRML is done mainly with the information of the first several number of stages. Shortening the trellis processing stages but implementing it with analog parallel circuits, several benefits including higher speed, no memory requirement and no A/D converter requirement are obtained. Most of the conventional analog parallel processing-based PRML decoders are differential architecture with the feedback of the previous decoded data. The architecture used in this paper is without feedback, where error metric accumulation is allowed to start from all the states of the decoding stage, which enables to be decoded without feedback. The circuit of the proposed architecture is simpler than that of the conventional analog parallel processing structure with the similar decoding performance. Characteristics of the feed forward differential architecture are investigated through various simulation studies.

목차

Abstract
Ⅰ. INTRODUCTION
Ⅱ. PR(1, 2, 2, 1)
Ⅲ. ANALOG DIFFERENTIAL VITERBI DECODER(ADVD)
Ⅳ. PRINCIPLE OPERATION OF PROPOSED ARCHITECURE
Ⅴ. SIMULATION RESULTS
Ⅵ. CONCLUSION
REFERENCES
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UCI(KEPA) : I410-ECN-0101-2010-560-003049232