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이용수
Abstract
Ⅰ. INTRODUCTION
Ⅱ. PROPOSED TEST PATTERN GENERATOR
Ⅲ. ARCHITECTURE OF MEMORY BIST
Ⅳ. EXPERIMENTAL RESULTS
Ⅴ. CONCLUSION
REFERENCES
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2001 .10
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2001 .11
혼합 모드 BIST 테스트 패턴 생성기
전기학회논문지
1998 .07
SoC 내장 메모리를 위한 ARM 프로세서 기반의 프로그래머블 BIST
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2008 .06
분할 및 병렬 처리 방법에 의한 BIST의 테스트 시간 감소
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2000 .06
스캔 분할 기법을 이용한 저전력 Test-Per-Scan BIST
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2003 .07
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