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논문 기본 정보
- 자료유형
- 학술대회자료
- 저자정보
- 발행연도
- 2009.11
- 수록면
- 309 - 312 (4page)
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This paper presents a 1-V three-stage fully differential amplifier with buffered nested-Miller compensation. A transconductance stage is inserted in the feedback path to eliminate the right half plane (RHP) zero. In addition, a feedforward transconductance is used to enhance output large signal response. Using a standard 0.35-μm CMOS technology, measurement results demonstrate that DC gain greater than 90dB, gain-bandwidth product of 4.57MHz, and phase margin of 55? is achieved with 100pF output loads. The settling time for a 1-Vpp step is 2μs. All the circuits dissipate 110μW under a single 1-V power supply.
목차
Abstract
I. INTRODUCTION
II. CIRCUIT ARCHITECTURE
III. CIRCUIT IMPLEMENTATION
IV. EXPERIMENTAL RESULTS
V. CONCLUSION
ACKNOWLEDGMENT
REFERENCES
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