병렬연결법에 의한 1.8V CMOS Self-bias 고속 차동증폭기의 이득 개선

方駿鎬

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자료유형: 학술저널

저자정보: 方駿鎬 (전북대학교)

저널정보: 대한전기학회 전기학회논문지 전기학회논문지 제57권 제10호

발행연도: 2008.10

수록면: 1,888 - 1,892 (5page)

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In this paper, a new parallel CMOS self-bias differential amplifier is designed to use in high-speed analog signal processing circuits. The designed parallel CMOS self-bias differential amplifier is developed by using internal biasing circuits and the complement gain stages which are parallel connected. And also, the parallel architecture of the designed parallel CMOS self-bias differential amplifier can improve the gain and gain-bandwidth product of the typical CMOS self-bias differential amplifier. With 1.8V 0.8㎛ CMOS process parameter, the results of HSPICE show that the designed parallel CMOS self-bias differential amplifier has a dc gain and a gain-bandwidth product of 64 ㏈ and 49 ㎒ respectively.

#Self-bias #Differential amplifier #Internal biasing #High-speed analog #Complement gain

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1. [학술지(정기간행물)] - Bazes, M. / 1991 / Two novel fully complementary self-biased CMOS differential amplifier / IEEE J. Solid-State Circuits 26 : 165 ~ 168

2. [학술지(정기간행물)] - Wu, J. T. / 1988 / A 100MHz pipelined CMOS comparator / IEEE J. Solid-State Circuit 23 (6)

3. [학술지(정기간행물)] - Mc Carroll, B. J. / 1998 / high-speed CMOS comparator for use in an ADC / IEEE J. Solid-State Circuit 23 (1)

4. [학술지(정기간행물)] - Soliman A. Mahmoud / 2007 / Low-Voltage CMOS Current Feedback Operational Amplifier and Its Application / ETRI Journal 29 (2) : 212 ~ 218

5. [학술지(정기간행물)] - S.I. Cho / 2002 / Design of a New High Speed Amplifier Circuit for Analog Subsystems / Anal. Int. Circuits Signal Processing 33 : 57 ~ 63

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방준호

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