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논문 기본 정보
- 자료유형
- 학술대회자료
- 저자정보
- 저널정보
- 대한전자공학회 ITC-CSCC :International Technical Conference on Circuits Systems, Computers and Communications ITC-CSCC : 2009
- 발행연도
- 2009.7
- 수록면
- 683 - 686 (4page)
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This paper describes functional verification on adaptive FIR filter using SystemVerilog. SystemVerilog has characteristics of hardware description languages and hardware verification language by expansion of Verilog HDL. Adaptive filter is a kind of FIR filter using adaptive algorithm. In this paper, testbench-based verification environment which verifies the functionality of adaptive FIR filter has a layered structure and is implemented with SystemVerilog.
목차
Abstract
1. Introduction
2. Preliminary
3. Structure of Layered Testbench Verification Environment
4. Simulation and Validation
5. Conclusions
References
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