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논문 기본 정보
- 자료유형
- 학술대회자료
- 저자정보
- 저널정보
- 대한전자공학회 ICEIC : International Conference on Electronics, Informations and Communications ICEIC : 2010
- 발행연도
- 2010.6
- 수록면
- 414 - 416 (3page)
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This paper presents a high-speed, low-complexity Forward Error Correction (FEC) architecture based on a time-multiplexing three-parallel Reed-Solomon (RS) decoder for next-generation 100-Gb/s optical communication systems. We have designed a high-speed three-parallel RS(255,239) decoder. The derived structure can also be applied to impleme ... 전체 초록 보기
목차
Abstract
Ⅰ. Introduction
Ⅱ. 16- Channel Three-parallel Reed-Solomon Based FEC Architecture
Ⅲ. Results and Comparison
Ⅳ. Conclusions
Acknowledgments
References
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