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논문 기본 정보

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학술저널
저자정보
최영식 (부경대학교) 오정대 (부경대학교) 최혁환 (부경대학교)
저널정보
대한전자공학회 전자공학회논문지-TC 電子工學會論文誌 第47卷 TC編 第8號
발행연도
2010.8
수록면
47 - 52 (6page)

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본 논문에서는 기존의 위상고정루프에서 가장 큰 잡음의 원천인 전압제어발진기를 새로운 구조의 자기잡음제거 전압제어발진기(Self-noise suppressing voltage controlled oscillator)로 대체하여 위상고정루프 잡음 특성을 향상시킨 위상고정루프(Phase Locked Loop)를 제안 하였다. 제안한 구조의 전달함수는 기존의 구조의 전달함수와 달리 대역폭 근처에서 최대 25㏈ 작은 값을 가진다. 회로는 1.8V 0.18㎛ CMOS 공정의 파라미터를 이용하여 HSPICE로 시뮬레이션을 수행하고 회로의 동작을 검증하였다.

목차

요약
Abstract
Ⅰ. 서론
Ⅱ. 제안된 위상고정루프 설계
Ⅲ. 회로 설계
Ⅳ. 시뮬레이션 결과
Ⅴ. 결론
참고문헌
저자소개

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