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이용수
ABSTRACT
1. 서론
2. WDM 위상 검출 방식의 원리
3. 타이밍 추출회로
4. 실험결과
5. 결론
REFERENCES
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WDM 방식을 이용한 DPLL 구현에 관한 연구 ( A Study on the DPLL Implementation Using the WDM Phase Detector )
대한전자공학회 학술대회
1987 .07
2단 양자화기를 사용한 1차 DPLL의 성능 개선에 관한 연구 ( A Study on the Performance of a Modified Binary Quantized First-Order DPLL )
전자공학회지
1984 .05
DPLL을 이용한 클럭 및 데이터 복구회로 설계 ( A DPLL-Based Clock/Data Recovery Circuit Design )
CAD 및 VLSI 설계연구회지
1996 .01
반주기 표본화를 이용한 DPLL의 성능개선에 관한 연구 ( A Study on the Performance Improvement of DPLL Using a Half Period Sampling )
한국통신학회 학술대회논문집
1987 .01
아리랑 위성 2호 DPLL 설계 및 시간 동기 알고리즘
한국항공우주학회 학술발표회 초록집
2001 .11
다치 양자화한 일차 DPLL의 위상과 주파수 스텝 입력에 대한 해석 ( Analysis of a First Order Multilevel Quantized DPLL with Phase-and Frequency-Step Input )
전자공학회지
1983 .07
PSK-DPLL의 반송파 복귀에 관한 연구
대한전자공학회 학술대회
1983 .11
Speed Control and Stability of 3-Phase Induction Motor with DPLL
전기의세계
1981 .11
커패시터 멀티플라이어를 이용한 디지털 위상 고정 루프(DPLL)의 설계
대한전자공학회 학술대회
2013 .07
광 저장장치용 DPLL 을 위한 Noise Robust PD/FD 에 관한 연구
대한전자공학회 학술대회
2003 .07
칼만필터를 이용한 DPLL Bit Synchronizer ( Acquisition of DPLL Bit Synchronizer Using Modified Kalman Filter )
대한전자공학회 학술대회
1997 .01
Adaptive Carrier Recovery with Multi-Loop DPLL for Mobile Communication Applications
CAD 및 VLSI 설계연구회지
1995 .01
最低分散을 위한 제로 크로싱 DPLL 비트동기기 ( Zero-Crossing DPLL Bit-Synchronizer for Reduced Jitter Variance )
한국통신학회 학술대회논문집
1993 .01
最低分散을 위한 제로크로싱 DPLL 비트동기기
한국통신학회 학술대회논문집
1993 .11
A Design of CMOS 1st-Order Delay-Line DPLL for Clock Regeneration
ITC-CSCC :International Technical Conference on Circuits Systems, Computers and Communications
1996 .01
칼만필터를 이용한 DPLL Bit synchronizer
한국정보과학회 학술발표논문집
1997 .04
탐색공간의 범위축소를 위한 DPLL-DCO Controller 설계
한국컴퓨터정보학회논문지
2000 .09
WDM 광전송 기술
한국통신학회지(정보와통신)
2002 .03
WDM 기반 광 전달망 구축방안 ( Construction Methods for WDM based Optical Transport Network )
대한전자공학회 학술대회
1998 .01
WDM 광 전송 시스템에서의 원격 관리 기능
대한전자공학회 학술대회
2001 .11
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