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논문 기본 정보

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대한전자공학회 전자공학회논문지-SD 電子工學會論文誌 SD編 第44卷 第1號
발행연도
2007.1
수록면
76 - 83 (8page)

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본 논문에서는 한 개의 전하공유 커패시터와 계층적 비트라인을 이용한 저전력 롬을 제안하였다. (single charge-sharing capacitor ROM: SCSC-ROM) 제안된 SCSC-ROM은 전하공유 커패시터와 계층적 비트라인으로 비트라인의 전력소모를 크게 줄였다. 한 개의 전하공유 커패시터를 이용한 전하공유 기법으로 비트라인의 swing 전압을 크게 낮춤으로써 비트라인에서의 전력소모를 줄였다. 이때, 전하공유 커패시터를 dummy 비트라인으로 구현하여 노이즈에 강할 뿐만 아니라 설계를 쉽게 하였다. 계층적 비트라인 기법으로 비트라인의 커패시턴스를 줄임으로써 전력소모를 더욱 줄였다. 또한, 계층적 워드라인 디코더를 제안하여 컨트롤과 프리디코더에서 소모되는 전력을 줄일 수 있었다. 시뮬레이션 결과에서 4K×32비트의 SCSC-ROM의 소모전력은 기존의 롬의 37%로 줄었다. 칩은 0.25㎛ CMOS 공정으로 제작되었고, 2.5V의 240㎒ 동작에서 8.2㎽를 소모하였다.

목차

요약
Abstract
Ⅰ. 서론
Ⅱ. 본론
Ⅲ. 성능 비교 및 실험 결과
Ⅳ. 결론
참고문헌
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