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논문 기본 정보

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저널정보
한국ITS학회 한국ITS학회 논문지 한국ITS학회 논문지 제6권 제2호
발행연도
2007.1
수록면
126 - 137 (12page)

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본 논문에서는 새로운 ROM 압축방식을 사용한 저전력 직접 디지털 주파수 합성기를 제안하고 낮은 클럭에서 동작하는 위상 누적기를 병렬로 연결하여 높은 주파수를 생성하는 위상-사인 변환기를 설계한다. ROM 크기를 줄이기 위해 사인파를 양자화 할 때 일련의 차동 양자화 기술을 응용, 변형하여 양자화 ROM(Quantized ROM : Q-ROM)과 차동 ROM(Differential ROM : D-ROM)을 사용하는 QD-ROM 압축방식을 제안한다. 이를 사용함으로써 67.5%의 ROM 사이즈를 감소시킬 수 있고 ROM의 크기를 줄여 전력 소모를 줄일 수 있다.
#Direct Digital Frequency Synthesizer #DDFS #phase-to-sine converter #phase accumulator #ROM reduction

목차

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참고문헌 (10)

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A / 1984 / “CMOS/SOS frequency synthesizer LSI circuit for spread spectrum communications google schola A. Madisetti / Aug.1999 / A 100 MHz, 16-b direct digital frequency synthesizer with a 100 dBc spurious free dynamic range 34 (8) : 1034 ~ 1043 google schola Addison- Wesley Pub / 1990 / Introduction to Communication Systems google schola B. D. Yang / May2004 / An 800-MHz low-power direct digital frequency synthesizer with an on-chip D/A converter 39 (5) : 761 ~ 774 google schola Hu / 1992 / “The quantization effects of the CORDIC algorithm : 834 ~ 844 google schola

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