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Korean Institute of Information Scientists and Engineers 한국정보과학회 학술발표논문집 한국정보과학회 2002년도 봄 학술발표논문집 제29권 제1호(A)
발행연도
2002.4
수록면
16 - 18 (3page)

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이 논문의 연구 히스토리 (2)

2002

저전력 회로를 위한 비트 단위의 연산 최적화
엄준형 ,  김태환 한국정보과학회 학술발표논문집 2002.04 학술대회자료

2000

고속 회로를 위한 비트 단위의 연산 최적화
엄준형 ,  김영태 ,  김태환 외 2명 한국정보과학회 학술발표논문집 2000.04 학술대회자료

초록· 키워드

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고속 회로 합성에 있어서, Wallace 트리 스타일은 연산을 위한 가장 효율적인 수행 방식의 하나로 인식 되어졌다. 그러나, 이러한 방법을 빠른 곱셈기의 수행이나 여러가지 연산수행에 있어, 입력 시그널을 고려하지 않은 일반적인 구조로 수행되어졌다. 본 논문은 연산기에 있어서 이러한 제한점을 극복하는 문제를 다룬다. 우리는 캐리-세이브 방법을 ... 전체 초록 보기

목차

요약

1. 서론

2. 전력 소모 모델과 문제 정의

3. 전력 소모를 고려한 FA - 트리 할당을 위한 알고리즘

4. 실험

5. 결론

감사의 글

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