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고집적 메모리의 고장 및 결함 위치검출 가능한 BIST / BICS 회로의 설계 ( A Design of BIST / BICS Circuits for Detection of Fault and Defect and Their Locations in VLSI Memories )
한국통신학회논문지
1997 .10
고장 모델 기반 메모리 BIST 회로 생성 시스템 설계
전자공학회논문지-SD
2005 .02
메모리 테스트를 위한 BIST 기술
전자공학회지
1995 .12
연상 메모리를 위한 BIST 회로 설계에 관한 연구 ( A Study on design BIST Circuit for Content Addressable Memory )
한국통신학회 학술대회논문집
1996 .01
VHDL을 이용한 테스트 알고리즘의 BIST 회로 설계
한국음향학회지
1999 .01
A Design of BIST Circuit for Testing ULSI DRAM
ICEIC : International Conference on Electronics, Informations and Communications
1995 .01
A Design of BIST Circuit for Testing ULSI DRAM
ICEIC : International Conference on Electronics, Informations and Communications
1995 .08
P1838 표준의 Memory BIST를 재활용 한 3차원으로 적층 된 플랫 메모리 자체 테스트 기법
한국통신학회 학술대회논문집
2015 .01
혼성 신호 회로에 대한 효과적인 BIST
전자공학회논문지-SD
2002 .08
내장 메모리 테스트를 위한 BIST 회로 자동생성기 ( Automatic BIST Circuit Generator for Embedded Memories )
전자공학회논문지-SD
2001 .10
플래시 메모리를 위한 유한 상태 머신 기반의 프로그래머블 자체 테스트
전자공학회논문지-SD
2007 .06
입력신호 그룹화 방법에 의한 BIST의 테스트 시간 감소 ( Test Time Reduction of BIST by Primary Input Grouping Method )
전자공학회논문지-SD
2000 .08
효율적인 캐쉬 테스트 알고리듬 및 BIST 구조 ( An Effective Cache Test Algorithm and BIST Architecture )
전자공학회논문지-C
1999 .12
메모리의 고장과 결함 검출 가능한 BIST 회로의 설계
대한전자공학회 학술대회
1996 .11
반도체 메모리의 Built-In Self Test ( BIST )
전자공학회지
1992 .05
회로분할과 테스트 입력 벡터 제어를 이용한 저전력 Scan-based BIST 설계
대한전자공학회 학술대회
2001 .06
혼합 모드 BIST 테스트 패턴 생성기
전기학회논문지
1998 .07
메모리의 고장과 결함 검출 가능한 BIST 회로의 설계 ( A Design of Fault and Defectable BIST Circuit for Memories )
대한전자공학회 학술대회
1996 .11
An Efficient BIST (Built-in Self-test) for A/D converters
대한전자공학회 ISOCC
2007 .10
Embedded RAM 테스트를 위한 BIST 회로 설계
대한전자공학회 학술대회
1996 .11
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